硬件工程师面试笔试试题集(一)

xiaoyu 发帖于 2013年11月19日 12:09:06
评论(3) / 浏览(1651)
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硬件面试题之一
1、下面是一些基本的数字电路知识问题,请简要回答之。
(1) 什么是Setup 和Hold时间?
答:Setup/Hold Time用于测试芯片对输入信号和时钟信号之间的时间要求。建立时间(Setup Time)是指触发器的时钟信号上升沿到来以前,数据能够保持稳定不变的时间。输入数据信号应提前时钟上升沿(如上升沿有效)T时间到达芯片,这个T就是建立时间通常所说的Setup Time。如不满足Setup Time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿到来时,数据才能被打入触发器。 保持时间(Hold Time)是指触发器的时钟信号上升沿到来以后,数据保持稳定不变的时间。如果Hold Time 不够,数据同样不能被打入触发器。
(2) 什么是竞争与冒险现象?怎样判断?如何消除?
答:在组合逻辑电路中,由于门电路的输入信号经过的通路不尽相同,所产生的延时也就会不同,从而导致到达该门的时间不一致,我们把这种现象叫做竞争。由于竞争而在电路输出端可能产生尖峰脉冲或毛刺的现象叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法:一是添加布尔式的消去项,二是在芯片外部加电容。
(3) 请画出用D触发器实现2倍分频的逻辑电路?

答:把D触发器的输出端加非门接到D端即可,如下图所示:

\

一般说来,CMOS电平比TTL电平有着更高的噪声容限。如果不考虑速度和性能,一般TTL与CMOS器件可以互换。但是需要注意有时候负载效应可能引起电路工作不正常,因为有些TTL电路需要下一级的输入阻抗作为负载才能正常工作。
2、 可编程逻辑器件在现代电子设计中越来越重要,请问:
(1) 你所知道的可编程逻辑器件有哪些?
答:ROM(只读存储器)、PLA(可编程逻辑阵列)、FPLA(现场可编程逻辑阵列)、PAL(可编程阵列逻辑)、GAL(通用阵列逻辑),EPLD(可擦除的可编程逻辑器件)、FPGA(现场可编程门阵列)、CPLD(复杂可编程逻辑器件)等 ,其中ROM、FPLA、PAL、GAL、EPLD是出现较早的可编程逻辑器件,而FPGA和CPLD是当今最流行的两类可编程逻辑器件。FPGA是基于查找表结构的,而CPLD是基于乘积项结构的。
(2) 试用VHDL或VERILOG、ABLE描述8位D触发器逻辑。
答:由于涉及硬件描述语言,本人对这方面一窍不通,很抱歉不能给出参考答案,希望高手跟帖!
3、设想你将设计完成一个电子电路方案,请简述用EDA软件(如PROTEL)进行设计(包括原理图和PCB图)到调试出样机的整个过程。在各环节应注意哪些问题?
答:完成一个电子电路设计方案的整个过程大致可分为以下几个步骤:(1) 原理图设计;(2) PCB设计;(3) 投板;(4) 元器件焊接;(5) 模块化调试;(6) 整机调试。各环节注意问题如下:
(1) 原理图设计阶段

注意适当加入旁路电容与去耦电容;

注意适当加入测试点和0欧电阻以方便调试时测试用;

注意适当加入0欧电阻、电感和磁珠以实现抗干扰和阻抗匹配;
(2) PCB设计阶段

自己设计的元器件封装要特别注意以防止板打出来后元器件无法焊接;

FM部分走线要尽量短而粗,电源和地线也要尽可能粗;

旁路电容、晶振要尽量靠近芯片对应管脚;

注意美观与使用方便;
(3) 投板

说明自己需要的工艺以及对制板的要求;
(4) 元器件焊接

防止出现芯片焊错位置,管脚不对应;

防止出现虚焊、漏焊、搭焊等;
(5) 模块化调试

先调试电源模块,然后调试控制模块,然后再调试其它模块;

上电时动作要迅速,发现不会出现短路时在彻底接通电源;

调试一个模块时适当隔离其它模块;

各模块的技术指标一定要大于客户的要求;
(6) 整机调试

由于整机调试时仍然会出现很多问题,而且这些问题往往更难解决,如提高灵敏度等,这时一定不要手忙脚乱,要多向高手请教!

xiaoyu
发帖时间:2013年11月19日 12:09
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非常好,谢谢你!
arm闲人
arm闲人
评论时间:2013年11月19日 12:18:16
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很好!谢谢分享!

chongdazds
chongdazds
评论时间:2013年12月6日 17:12:49
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多谢分享!
longc51
longc51
评论时间:2014年4月4日 10:30:09
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分享我看的,我做的,我写的,给别人带了方便,渐渐发现这些其实也给自己做了一个厚重的广告,世界上的事从来都是这样,无意插柳柳成荫。

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